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| Core Duo (Yonah) | Core 2 Duo (Merom) | |
|
Manufacturing Process |
65nm |
65nm |
|
Die Size |
90.3 mm^2 |
144.9 mm^2 |
|
Transistors |
151M |
291M |
|
Clock Speeds |
1.20GHz - 2.33GHz |
1.06GHz - 2.4GHz+ |
|
FSB Frequency |
533MHz - 667MHz |
533MHz - 800MHz |
|
L1 Cache Size |
32KB + 32KB |
32KB + 32KB |
|
L2 Cache Size |
2MB Shared |
2MB - 4MB Shared |
|
Pipeline Stages |
12 |
14 |
|
Decoders |
1 complex + 2 simple |
1 complex + 3 simple |
|
Maximum Decode Rate |
3 |
4+1 |
|
Reorder Buffer |
80 |
96 |
|
Issue Ports |
5 |
6 |
|
Scheduling |
Unified Reservation Station |
Unified Reservation Station |
|
Scheduler (# of Entries) |
24 |
32 |
|
FP Units |
FMUL/FADD: 1 |
FMUL: 1 |
|
SSE Units |
1 |
3 |
|
Integer Units |
ALU: 2 AGU: 2 |
ALU: 3 AGU: 2 |
|
Load/Store Units |
Load: 1 Store: 1 |
Load: 1 Store: 1 |
|
Socket Interface |
Socket-M (PGA/BGA) |
Socket-M (PGA/BGA) & Socket-P (PGA/BGA) |
출처 : www.pcgoon.com
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elwos56
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